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C8051T610/1/2/3/4/5/6/7
Table 16.1. Interrupt Summary
Interrupt Source
Reset
Interrupt
Vector
0x0000
Priority
Order
Top
Pending Flag
None
Enable
Flag
N/A N/A Always
Priority
Control
Always
Enabled
Highest
External Interrupt 0
0x0003
0
IE0 (TCON.1)
Y Y EX0 (IE.0) PX0 (IP.0)
(INT0)
Timer 0 Overflow
External Interrupt 1
0x000B
0x0013
1
2
TF0 (TCON.5)
IE1 (TCON.3)
Y
Y
Y
Y
ET0 (IE.1) PT0 (IP.1)
EX1 (IE.2) PX1 (IP.2)
(INT1)
Timer 1 Overflow
UART0
0x001B
0x0023
3
4
TF1 (TCON.7)
RI0 (SCON0.0)
Y
Y
Y
N
ET1 (IE.3) PT1 (IP.3)
ES0 (IE.4) PS0 (IP.4)
TI0 (SCON0.1)
Timer 2 Overflow
0x002B
5
TF2H (TMR2CN.7)
Y
N
ET2 (IE.5) PT2 (IP.5)
TF2L (TMR2CN.6)
SPI0
0x0033
6
SPIF (SPI0CN.7) ?
Y
N
ESPI0
PSPI0
WCOL (SPI0CN.6)
MODF (SPI0CN.5)
RXOVRN (SPI0CN.4)
(IE.6)
(IP.6)
SMB0
0x003B
7
SI (SMB0CN.0)
Y
N
ESMB0
PSMB0
(EIE1.0)
(EIP1.0)
RESERVED
ADC0 Window Com-
pare
ADC0 Conversion
0x0043
0x004B
0x0053
8
9
10
N/A
AD0WINT
(ADC0CN.3)
AD0INT (ADC0CN.5)
N/A N/A N/A
Y N EWADC0
(EIE1.2)
Y N EADC0
N/A
PWADC0
(EIP1.2)
PADC0
Complete
(EIE1.3)
(EIP1.3)
Programmable Coun-
ter Array
0x005B
11
CF (PCA0CN.7)
CCFn (PCA0CN.n)
Y N EPCA0
(EIE1.4)
PPCA0
(EIP1.4)
COVF (PCA0PWM.6)
Comparator0
0x0063
12
CP0FIF (CPT0CN.4)
N
N
ECP0
PCP0
CP0RIF (CPT0CN.5)
(EIE1.5)
(EIP1.5)
Comparator1
0x006B
13
CP1FIF (CPT1CN.4)
N
N
ECP1
PCP1
CP1RIF (CPT1CN.5)
(EIE1.6)
(EIP1.6)
Timer 3 Overflow
0x0073
14
TF3H (TMR3CN.7)
N
N
ET3
PT3
TF3L (TMR3CN.6)
(EIE1.7)
(EIP1.7)
16.2. Interrupt Register Descriptions
The SFRs used to enable the interrupt sources and set their priority level are described in this section.
Refer to the data sheet section associated with a particular on-chip peripheral for information regarding
valid interrupt conditions for the peripheral and the behavior of its interrupt-pending flag(s).
Rev 1.1
87
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